（1）Run Synthesis（綜合設(shè)定）

首先點擊Run Synthesis,也就是對程序進(jìn)行綜合，綜合的結(jié)果可以查看，同時也可以查看時序綜合報告以及能量消耗報告等。

（2）Run Implementation（實現(xiàn)設(shè)定）

在執(zhí)行這一步驟時如果前面沒有執(zhí)行Run Synthesis時會先執(zhí)行synthesis，如已經(jīng)執(zhí)行過了則會直接執(zhí)行Implementation。在這一步驟結(jié)束后可以查看FPGA邏輯電路等配置結(jié)果

（3）Generate Bitstream（生成二進(jìn)制流）

同樣在執(zhí)行這一步驟時如果前面步驟還沒有實現(xiàn)，會先將上述步驟實現(xiàn)下然后再執(zhí)行生成二進(jìn)制流，生成二進(jìn)制流文件后便可以下載實驗了。

總結(jié)

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